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HDL Coder: Timing Error bei Raised Cosine Transmit Filter |
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| Tobias93 |
Forum-Newbie
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Beiträge: 3
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Verfasst am: 30.03.2017, 14:59
Titel: HDL Coder: Timing Error bei Raised Cosine Transmit Filter
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Hallo zusammen!
Ich möchte gerne HDL Coder nutzen, um einen einfachen digitalen Sender in Hardware zu realisieren. Dazu nutze ich Simulink und HDL Coder.
Mit HDL Coder erstelle ich Verilog-Code, der auf einem FPGA-Board implementiert wird.
Leider verursacht das im Simulink-Modell enthaltene Raised Cosine Transmit Filter bei der Weiterverarbeitung des Verilog-Codes einen Timing Error.
Kennt sich jemand mit den nötigen Einstellungen für HDL-Coder aus, um solche Timing Errors bei Raised Cosine Transmit Filtern zu vermeiden (Distributed Pipelining, etc.)?
Vielen Dank im Voraus!
Tobias
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| Andreas Goser |
Forum-Meister
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Beiträge: 3.654
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Verfasst am: 31.03.2017, 09:46
Titel:
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Hallo Tobias, wie auch bei der ersten Anfrage im letzten Jahr ist zu erwarten, dass hier keine Antwort kommt. Diese Produkte haben im deutschsprachigen Raum einen überschaubaren Nutzerkreis in der Industrie (und ein wenig Hochschule). Die Helfer in diesem Forum kommen - sofern es nicht MathWorks Mitarbeiter sind) zumeist aus dem Hochschul-Umfeld.
Falls also hier nichts kommt ist es ratsam den MathWorks Support zu kontaktieren.
Andreas
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| Tobias93 |
Themenstarter
Forum-Newbie
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Beiträge: 3
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Verfasst am: 03.04.2017, 10:09
Titel: HDL Coder
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Okay, danke für die Einschätzung! 
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